دسترسی نامحدود
برای کاربرانی که ثبت نام کرده اند
برای ارتباط با ما می توانید از طریق شماره موبایل زیر از طریق تماس و پیامک با ما در ارتباط باشید
در صورت عدم پاسخ گویی از طریق پیامک با پشتیبان در ارتباط باشید
برای کاربرانی که ثبت نام کرده اند
درصورت عدم همخوانی توضیحات با کتاب
از ساعت 7 صبح تا 10 شب
ویرایش: نویسندگان: Ayan Mandal, Sunil P. Khatri, Rabi Mahapatra سری: ISBN (شابک) : 1461494044, 9781461494041 ناشر: Springer سال نشر: 2014 تعداد صفحات: 151 زبان: English فرمت فایل : PDF (درصورت درخواست کاربر به PDF، EPUB یا AZW3 تبدیل می شود) حجم فایل: 3 مگابایت
در صورت تبدیل فایل کتاب Source-Synchronous Networks-On-Chip: Circuit and Architectural Interconnect Modeling به فرمت های PDF، EPUB، AZW3، MOBI و یا DJVU می توانید به پشتیبان اطلاع دهید تا فایل مورد نظر را تبدیل نمایند.
توجه داشته باشید کتاب منبع-شبکه های همزمان - تراشه: مدل سازی اتصال متقابل مدار و معماری نسخه زبان اصلی می باشد و کتاب ترجمه شده به فارسی نمی باشد. وبسایت اینترنشنال لایبرری ارائه دهنده کتاب های زبان اصلی می باشد و هیچ گونه کتاب ترجمه شده یا نوشته شده به فارسی را ارائه نمی دهد.
این کتاب روشهای جدیدی را برای طراحی شبکه روی تراشه (NoC) با استفاده از ساعتهای رزونانسی پرسرعت منبع-همزمان توصیف میکند. نویسندگان قبل از ارائه شبیهسازیهای معماری، NoCها را از پایین به بالا مورد بحث قرار میدهند و جزئیات سطح مدار را ارائه میکنند. در نتیجه، خوانندگان تصویر کاملی از نحوه طراحی و بهینه سازی یک NoC خواهند داشت. با استفاده از روشهایی که در این کتاب توضیح داده شده است، خوانندگان قادر به طراحی NoCهایی هستند که از نظر تاخیر و توان عملیاتی 5 برابر بهتر از روشهای موجود هستند و همچنین میتوانند حجم قابل توجهی ترافیک را حفظ کنند.
This book describes novel methods for network-on-chip (NoC) design, using source-synchronous high-speed resonant clocks. The authors discuss NoCs from the bottom up, providing circuit level details, before providing architectural simulations. As a result, readers will get a complete picture of how a NoC can be designed and optimized. Using the methods described in this book, readers are enabled to design NoCs that are 5X better than existing approaches in terms of latency and throughput and can also sustain a significantly greater amount of traffic.
Front Matter....Pages i-xiii
Introduction....Pages 1-13
Clock Distribution for Fast Networks-on-Chip....Pages 15-66
Fast Network-on-Chip Design....Pages 67-127
Fast On-Chip Data Transfer Using Sinusoid Signals....Pages 129-137
Conclusion and Future Work....Pages 139-140
Back Matter....Pages 141-143